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實(shí)習(xí)報(bào)告
學(xué)生姓名：趙承鵬
學(xué)生學(xué)號(hào)：20072130
專業(yè)班級(jí)：07集成01班
完成時(shí)間：2011年2月
實(shí)習(xí)目的通過(guò)本次實(shí)習(xí)使所學(xué)知識(shí)能夠從理論高度上升到實(shí)踐高度，更好的實(shí)現(xiàn)理論和實(shí)踐的結(jié)合。
通過(guò)本次實(shí)習(xí)來(lái)親身感受layout版圖設(shè)計(jì)的過(guò)程，同時(shí)更好的學(xué)習(xí)和了layout版圖設(shè)計(jì)的工藝與方法。
通過(guò)本次實(shí)習(xí)掌握一定的EDA工具（Cadence）使用方法，提高自身的專業(yè)技能，為畢業(yè)就業(yè)做好準(zhǔn)備。
實(shí)習(xí)時(shí)間
2011年2月
實(shí)習(xí)地點(diǎn)
天津市濱海新區(qū)集成電路設(shè)計(jì)服務(wù)中心
實(shí)習(xí)內(nèi)容
1、培訓(xùn)機(jī)構(gòu)介紹
天津?yàn)I海新區(qū)集成電路設(shè)計(jì)服務(wù)中心（BICDS)是政府全資建設(shè)的非盈利機(jī)構(gòu)。是天津經(jīng)濟(jì)技術(shù)開(kāi)發(fā)區(qū)大力扶持集成電路設(shè)計(jì)產(chǎn)業(yè)規(guī)劃的重要組成部分。中心以完善的政策及服務(wù)體系，通過(guò)提供研發(fā)費(fèi)用、軟件費(fèi)用、MPW費(fèi)用補(bǔ)貼及增值稅全額財(cái)政補(bǔ)貼等政策，輔以研發(fā)—產(chǎn)品—市場(chǎng)的一站式解決方案，為企業(yè)打造最具競(jìng)爭(zhēng)力成長(zhǎng)及發(fā)展環(huán)境。
2、培訓(xùn)內(nèi)容
Cadence Assura Verification培訓(xùn)
針對(duì)EDA工具（Cadence）使用及方法的培訓(xùn)，Cadence 是一個(gè)大型的EDA 軟件它幾乎可以完成電子設(shè)計(jì)的方方面面，包括ASIC 設(shè)計(jì)FPGA 設(shè)計(jì)和PCB 板設(shè)計(jì)與眾所周知的EDA 軟件Synopsys相比Cadence 的綜合工具略為遜色然而Cadence 在仿真電路圖設(shè)計(jì)自動(dòng)布局布線版圖設(shè)計(jì)及驗(yàn)證等方面卻有著絕對(duì)的優(yōu)勢(shì)Cadence 與Synopsys的結(jié)合可以說(shuō)是EDA 設(shè)計(jì)領(lǐng)域的黃金搭檔此外Cadence 公司還開(kāi)發(fā)了自己的編程語(yǔ)言skill,并為其編寫了編譯器由于skill 語(yǔ)言提供編程接口甚至與C 語(yǔ)言的接口所以可以以Cadence 為平臺(tái)進(jìn)行擴(kuò)展用戶還可以開(kāi)發(fā)自己的基于Cadence 的工具實(shí)際上整個(gè)Cadence 軟件可以理解為一個(gè)搭建在skill語(yǔ)言平臺(tái)上的可執(zhí)行文件集。
Cadence平臺(tái)的啟動(dòng)
使用用戶名和密碼登陸入服務(wù)器。
右擊桌面，在彈出菜單中單擊open Terminal。
在彈出的終端中鍵入U(xiǎn)nix命令icfb&然后按回車啟動(dòng)Cadence。
Cadence啟動(dòng)完成后，關(guān)閉提示信息。設(shè)計(jì)項(xiàng)目的建立
點(diǎn)擊Tools-Library Manager啟動(dòng)設(shè)計(jì)庫(kù)管理軟件。
點(diǎn)擊File-New-Library 新建設(shè)計(jì)庫(kù)文件。
在彈出的菜單項(xiàng)中輸入你的設(shè)計(jì)庫(kù)的名稱，比如My Design,點(diǎn)擊OK。選擇關(guān)聯(lián)的工藝庫(kù)文件，點(diǎn)擊OK。
在彈出的菜單中的Technology Library下拉菜單中選擇需要的工藝庫(kù)，然后單擊OK
設(shè)計(jì)的項(xiàng)目庫(kù)文件建立完成，然后我們?cè)谶@個(gè)項(xiàng)目庫(kù)的基礎(chǔ)上建立其子項(xiàng)目。點(diǎn)擊選擇My Design，然后點(diǎn)擊File-New-Cell View。
輸入子項(xiàng)目的名稱及子項(xiàng)目的類型，這設(shè)計(jì)版圖之前我們假定先設(shè)計(jì)原理圖：所以我們選擇Composer-Schematic，然后點(diǎn)擊OK。
進(jìn)入原理圖編輯平臺(tái) 原理圖設(shè)計(jì)
輸入器件：點(diǎn)擊Instance按鍵或快捷鍵I插入器件。
查找所需要的器件類型-點(diǎn)擊Browse-tsmc35mm-pch5
點(diǎn)擊Close
更改器件參數(shù)，主要是寬和長(zhǎng)。
點(diǎn)擊Hide，在編輯作業(yè)面上點(diǎn)擊插入剛才設(shè)定的器件。
如果想改參數(shù)器件，點(diǎn)擊選擇該器件，然后按Q，可以修改參數(shù)器件
使用同樣的方法輸入Nmos,工藝庫(kù)中叫nch5.點(diǎn)擊Wire(narrow)手動(dòng)連線。
完成連線后，輸入電源標(biāo)志和地標(biāo)志：在analogLib庫(kù)中選擇VDD和
GND，輸入電源線標(biāo)示符。
接輸入輸出標(biāo)示腳：按快捷鍵P，輸入引腳名稱in, Direction選擇input,點(diǎn)擊Hide，并且和輸入線連接起來(lái)。同理設(shè)置輸出引腳Out。
版圖初步
建立新的Cell，點(diǎn)擊File-New-Cell View 還是建立名稱為inv的版圖編輯文件，Tool選擇Virtuoso版圖編輯軟件，點(diǎn)擊OK，關(guān)閉信息提示框。進(jìn)入版圖編輯環(huán)境
插入pmos和nmos器件且設(shè)置器件參數(shù)，點(diǎn)擊Hide，然后放置pch5版
圖。使用同樣的方法放置Nch5管的版圖。然后按“shift+f”顯示器件具體每層圖形（再按ctrl+f隱藏）
編輯幾何圖形進(jìn)行連線-多晶硅，選擇POLY1，多晶硅。
選擇Polygon編輯幾何圖形，把Nmos的柵極和Pmos的柵極相連。
使用同樣的方法連接器件的漏極和源端。
完成后使用版圖驗(yàn)證系統(tǒng)進(jìn)行DRC（設(shè)計(jì)規(guī)則檢查）。
實(shí)習(xí)心得
為期八天的實(shí)習(xí)培訓(xùn)使我受益匪淺，在這部分的學(xué)習(xí)中，我不僅學(xué)習(xí)到了一些教材中涉及但又未能深入解釋清楚的知識(shí)和技能，更可貴的是能為我提供這樣動(dòng)手實(shí)習(xí)機(jī)會(huì)，使我在原有的理論的基礎(chǔ)之上又增加了許多的實(shí)踐經(jīng)驗(yàn)，本次培訓(xùn)是一次有效的培訓(xùn)，從了解Cadence到初步掌握其使用方法再到延伸提高，我一步一步的了解了layout版圖設(shè)計(jì)的規(guī)則和方法。首先每天的專題視頻教學(xué)，生動(dòng)直觀的讓我學(xué)習(xí)到了layout版圖設(shè)計(jì)的理論基礎(chǔ)和理論方法。再通過(guò)之后的上機(jī)實(shí)驗(yàn)，加強(qiáng)鞏固了所學(xué)到的知識(shí)，更親身體驗(yàn)使用Cadence軟件。當(dāng)然要做好layout版圖設(shè)計(jì)也不是這么簡(jiǎn)單的，需要扎實(shí)的理論基礎(chǔ)知識(shí)和日積月累的設(shè)計(jì)經(jīng)驗(yàn)，只有這些才能造就一位優(yōu)秀的layout設(shè)計(jì)師。而我只是處于起步階段，往后發(fā)展的道路還很長(zhǎng)。不積跬步，無(wú)以至千里。不積小流，無(wú)以成江海。也只有通過(guò)不斷的學(xué)習(xí)和積累，我才能夠提高。最后，感謝學(xué)校給了我一次良好的學(xué)習(xí)機(jī)會(huì)，同時(shí)感謝濱海集成電路中心提供了這么好的實(shí)踐學(xué)習(xí)機(jī)會(huì)。這些都是我以后人生中的寶貴知識(shí)財(cái)富，再次感謝你們！
